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An Agile RISC-V SoC Design Framework with in-order cores, out-of-order cores, accelerators, and more

解决的问题

Chipyard 旨在简化基于 Chisel 的定制系统级芯片(SoC)的敏捷开发。它提供了一个统一的框架,整合了多种处理器核心、加速器和工具,以更高效地实现从设计到实现的流程。

工作原理

该框架利用 Chisel 硬件描述语言(HDL)和 Rocket Chip SoC 生成器来生成 RISC-V SoC。它集成了以下几个关键组件:

  • 处理器核心:支持 Rocket、BOOM 和 CVA6(Ariane)。
  • 向量单元:集成 Saturn 和 Ara 向量单元。
  • 加速器:包含面向 AI 的加速器,如 Gemmini 和 NVDLA。
  • 内存与外设:提供内存系统和 MMIO 映射的外设。
  • 开发流程:支持软件 RTL 模拟、通过 FireSim 实现的 FPGA 加速模拟、通过 Hammer 实现的自动化 VLSI 流程,以及通过 FireMarshal 实现的软件工作负载生成。

适用人群

专注于 RISC-V 和定制 SoC 开发的硬件架构师、VLSI 设计师和研究人员。

主要亮点

  • 集成生态系统:将核心、向量单元和加速器整合到一个统一框架中。
  • 敏捷硬件开发:支持从模拟到 VLSI 实现的多种并行开发流程。
  • 基于 RISC-V:以 RISC-V 指令集架构为基础构建。
  • 全面的工具链:包含用于模拟(FireSim)和自动化 VLSI 流程(Hammer)的专业工具。

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